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文檔簡介

74HC13874HC138 38譯可接3位二進制地址輸入（A0A1A3），并當使能時，提8個互斥的低有效輸出（Y0Y7）。74HC1383個使能輸入端：兩個低有效（E1E2）效（E3）。E1E2置低E3置高，否74HC138將保持所474HC1381個反相器，即可輕松實現并行擴展，組1-32（532線）74HC138亦可充當一8輸出多路分配器，未使用的使能輸入綁3874HC238邏輯功能一致，只不74HC138為反相輸出。

74HC138參74HC138基本參數 +/-5.2 1274HC138其他特 74HC138封裝與引腳SO16,SSOP16,DIP16,路分配JEDEC標準no.7A儲 -40～+85-40～+12574HC165基本74HC165基本參74HC165參 標準o.7A。74HC165引腳兼容低功

74HC165是8位并 或串行輸入移位寄存器，可在末級得到互斥的串行輸出（Q7和Q7），當并 74HC165封裝與 5674HC165封裝與 56 低功耗或電池供電應74HC165其他特PL為高時，數據將DS輸入端串行進入寄存器，在每個時鐘脈沖的上升沿向右移動一位（Q0Q1Q2，等等）。利用只要把Q7輸出綁定到下一級的DS輸入，即可實現并轉串擴展。74HC165的時鐘輸入是一個“門控或”結構，允許其中一個輸入端作為低有效時鐘使能（CE）輸入。CPCE的引腳分配是獨立防止數據在PL的活動狀態發生位移。C165特8位并步串行SD保護-40～+85-40～+125

+/-5.2 16SO16,SSOP16,DIP16,74HC164參74HC16474HC164參74HC164基本參+/-5.21274HC164其他特78 系列 標準o.7A74HC164封裝與 低功耗或電池供電應74HC164封裝與 低功耗或電池供電應在時鐘脈沖（CP）的每個上升沿，數據將向右移動一位，并輸入至Q0，Q0C164

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